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实验一 1位全加器电路设计

实验一 1位全加器电路的设计

一、实验目的

1、学会利用Quartus Ⅱ软件的原理图输入方法设计简单的逻辑电路; 2、熟悉利用Quartus Ⅱ软件对设计电路进行仿真的方法; 3、理解层次化的设计方法。

二、实验内容

1、用原理图输入方法设计完成一个半加器电路。并进行编译与仿真。

2、设计一个由半加器构成1位全加器的原理图电路,并进行编译与仿真。 3、设计一个由1位全加器构成4位加法器的原理图电路,并进行编译与仿真。

三、实验步骤

1. 使用Quartus建立工程项目

从【开始】>>【程序】>>【ALtera】>>【QuartusII6.0】打开Quartus软件,界面如图1-1示。

图1-1 Quartus软件界面

在图1-1中从【File】>>【New Project Wizard...】新建工程项目,出现新建项目向导New Project Wizard 对话框如图1-2

实验一  1位全加器电路设计

所示。该对话框说明新建工程应该完成的

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